Práctica realizada en VHDL para realizar un cronómetro con alarma en la FPGA Nexys A7. Proyecto desarrollado para la asignatura Diseño de Sistemas Electrónico con FPGA del Máster de Electrónica Industrial.
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Practica de un cronómetro con alarma en VHDL para la FPGA Nexys A7
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AugustoS97/cronometro-vhdl
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Practica de un cronómetro con alarma en VHDL para la FPGA Nexys A7
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